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全志安卓主板电路板设计过程中常见的几大误区和解答


今天就给大家介绍一下,全志安卓主板电路板设计过程里面常见的几大误区和解答。希望可以帮到各位解答心中的疑惑。

误区1:版子的PCB设计要求不高,用细一点的线自动布吧

自动布线需要占用更大的PCB面积,同时还会产生比手动布线多好多的孔洞,在批量较大的产品中,PCB厂家除了会考虑到商务因素外,还会考虑线宽和孔洞的数量,这些都会影响到PCB的成品率和钻头消耗的数量。

误区2:总线信号都用电阻拉一下吧,感觉这样会放心一些

信号需要上下拉的原因可是有很多的,不是说个个都要拉,上下拉电阻拉一个单纯的输入信号,电流不过是几十微安。要是拉了一个被驱动了的信号,那电流就可以达到毫安级了。现在系统大部分都是地址数据各32位,可能有些是224/245隔离后总线及其它信号,要是都上拉的话,就会多消耗几瓦的功能在电阻上。

误区3:CUP和FPGA这些不用的I/O口要怎么处理啊?那就先空着吧,后面再说。

那些不用I/O口要是空着的话,受到外面一点点干扰,都有可能会成为反复震荡的输入信号。而MOS器件的功耗基本就取决于门电路翻转的次数。如果它上拉的话,每一个引脚都会有微安级别的电流经过,所以比较合适的解决方法就是设置成输出。

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